admin管理员组

文章数量:1531474

2024年7月14日发(作者：)

前些日子用ise的ddr2的ip核联合modulsim仿真镁光的ddr2的verilog模型，

但是总是编译会报错。后来看了一下镁光下载过来的文件中有说明，和大家分享一下，希

望有帮助。

首先镁光下载的文件夹里有这么些个东西：

ddr2.v是用的仿真期间模型。就是可以用来仿真的。

DDR2_module好像好几个DDR2集成写到一起的。

DDR2_mcp一些参数

Ddr2—— 也是一些参数的配置

Readme 这个比较重要，里面告诉你怎么配置

文件时modulsim的批量处理文件，关于modulsim怎么通过编写do文件自

动调用ise的工程仿真，这个在我的csdn上写过啦，有意可以参考。

Tb是厂家自己编写的一些个测试文件。

好了说重点。由于ddr2模型中是支持很多模式的，所以厂家在编写的时候利用大量

的define等，所以在使用的时候，我们就需要根据自己的要求来配置其相应的模式，这个

在readme这个文本文档中有写。

比如说这个：

告诉你在modlsim中怎么去配置ddr2的位数，这个readme给出的是8位的。

下面这个是我自己的modulsim中的写的do文件。供小伙伴们参考。

########################

#######################之间的数据就是配置文件。

下面的是ise的ddr2的文件。

仅供参考

本文标签： 文件模型配置编写时候

版权声明：本文标题：仿真镁光DDR2的verilog模型时的一些注意问题 内容由热心网友自发贡献，该文观点仅代表作者本人， 转载请联系作者并注明出处：https://m.elefans.com/dongtai/1720931443a850946.html， 本站仅提供信息存储空间服务，不拥有所有权，不承担相关法律责任。如发现本站有涉嫌抄袭侵权/违法违规的内容，一经查实，本站将立刻删除。